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基于射频开关模块功能电路PCB板的设计|博鱼boyu体育sports

作者:博鱼·boyu体育时间:2024-11-25 02:56:01 次浏览

信息摘要:

随着现代无线通信系统的发展,移动通信、雷达、卫星通信等通信系统对发送转换电源的电源速度、功率容量、集成性等方面有了更高的拒绝,因此研究VXI总线技术,研发符合军方特殊要求的VXI总线模块,具备十分最重要的意义,我们将利用虚拟仪器思想,将硬件电路以软件

本文摘要:随着现代无线通信系统的发展,移动通信、雷达、卫星通信等通信系统对发送转换电源的电源速度、功率容量、集成性等方面有了更高的拒绝,因此研究VXI总线技术,研发符合军方特殊要求的VXI总线模块,具备十分最重要的意义,我们将利用虚拟仪器思想,将硬件电路以软件的方式构建,以下设计的射频电源可以由计算机必要掌控,可以很便利地与VXI总线测试系统集成,最大限度的发挥计算机和微电子技术在当今测试领域中的应用于,具备辽阔的发展前景。

随着现代无线通信系统的发展,移动通信、雷达、卫星通信等通信系统对发送转换电源的电源速度、功率容量、集成性等方面有了更高的拒绝,因此研究VXI总线技术,研发符合军方特殊要求的VXI总线模块,具备十分最重要的意义,我们将利用虚拟仪器思想,将硬件电路以软件的方式构建,以下设计的射频电源可以由计算机必要掌控,可以很便利地与VXI总线测试系统集成,最大限度的发挥计算机和微电子技术在当今测试领域中的应用于,具备辽阔的发展前景。  1VXI总线模块电路的设计与构建  VXIbus是VMEbus在仪器领域的拓展,是计算机操控的模块化自动仪器系统。它依赖有效地的标准化,使用模块化的方式,构建了系列化、通用化以及VXIbus仪器的互换性和互操作性,其对外开放的体系结构和PlugPlay方式完全符合信息产品的拒绝。

它具备高速数据传输、结构紧凑、配备灵活性、电磁兼容性好等优点,,因此系统重新组建和用于十分便利,应用于也更加普遍,已渐渐沦为高性能测试系统集成的选用总线。  VXI总线是一种几乎对外开放的、限于于各仪器生产厂家的模块化仪器背板总线规范。

VXI总线器件主要分成:寄存器恩器件、消息恩器件和存储器恩器件。目前寄存器恩器件在应用于中所占到比例仅次于(大约70%)。

VXIbus寄存器恩模块电路主要还包括:总线缓冲器驱动、传输速率和译码电路、数据传输接收者状态机、配备及操作者寄存器组四个部分。四个部分中除总线缓冲器驱动使用74ALS245芯片来构建外,其余部分都用FPGA来构建。

使用一片FLEX10K芯片EPF10K10QC208-3和一片EPROM芯片EPC1441P8,利用适当软件MAX+PLUSⅡ来展开设计与构建。  1.1总线缓冲器驱动  该部分已完成对VXI背板总线中的数据线、地址线和控制线的缓冲器接管或驱动,以符合VXI规范信号的拒绝。对于A16/D16器件,只要构建背板数据总线D00~D15的缓冲器驱动。

根据VXI总线规范的拒绝,此部分使用两片74LS245构建,用DBEN*(由数据传输接收者状态机产生)来选通。  1.2传输速率和译码电路  传输速率线还包括地址线A01~A31、数据选通线DS0*和DS1*、宽字线LWORD*。控制线还包括地址选通线AS*和读书/写出信号线WRITE*。

  本电路的设计使用MAX+PLUSⅡ的原理图设计方式。利用元件库里的现有元件展开设计,使用了两片74688和一片74138。

  该功能模块对地址线A15~A01及地址改动线AM5~AM0展开译码。当器件被传输速率时,接管地址线及地址改动线上的地址信息,并将其与本模块上硬件地址电源设置的逻辑地址LA7~LA0相比较,如果AM5~AM0上逻辑值为29H或2DH(由于是A16/D16器件),地址线A15、A14皆为1,并且A13~A06上的逻辑值与模块的逻辑地址大于时,该器件被传输速率选通(CADDR*为真为)。接着其结果被送到下一级译码掌控,通过对地址A01~A05展开译码顺位模块在16位地址空间的寄存器。

  1.3数据传输接收者状态机  数据传输总线是一组高速异步分段数据传输总线,是VMEbus系统信息互相交换的主要组成部分。数据传输总线的信号线可分成传输速率线、数据线、控制线三组。

  该部分的设计使用MAX+PLUSⅡ的文本输出设计方式。由于DTACK*的时序比较复杂,所以使用AHDL语言来展开设计,通过状态机构建。

  该功能模块对VXI背板总线中的掌控信号展开组态,为标准数据传输周期获取时序及掌控信号(产生数据传输使能信号DBEN*,总线已完成数据传输所需的接收者信号DTACK*等)。在展开数据传输时,系统控制者首先对模块展开传输速率,并将适当的地址选通线AS*,数据选通线DS0*、DS1*以及掌控数据传输方向的WRITE*信号线等设置为有效地电平。

当模块检测到地址给定及各控制线有效地后,驱动DTACK*为低电平,以此向总线控制者证实早已将数据摆放在数据总线上(读书周期)或早已顺利地接管到数据(写出周期)。


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